Mach-NX:プログラマブル・システム制御向けハードウェア・セキュリティ

384ビット暗号化とMCTP-SPDMをサポート

サイバー・レジリエント・システム制御:セキュアな制御技術でのラティスのリーダーシップに基づき、進化するPFR要件に対応。改変不可能なセキュア・エンクレーブを搭載し、ハードウェアRoTと384ビット暗号化を可能に

ダイナミックなリアルタイム・エンド・ツー・エンド保護ナノ秒単位で応答可能なリアルタイム・ファームウェア保護を提供し、システム・バスに対する悪意のある行為を防止

迅速なカスタマイズが可能: Lattice Propelにより、RISC-V環境でのセキュリティ機能のコンフィギュレーションが容易。数日間でNIST SP 800-193 準拠PFRソリューションの開発が可能。

機能

  • 最大8.4K LCのユーザー・ロジック、2669 kビットのユーザー・フラッシュ・メモリ、デュアルブート・フラッシュ機能。
  • 1.2/1.5/1.8/2.5/3.3 I/O電圧をサポートする最大379のプログラマブルI/O
  • セキュア・エンクレーブによりSHA、HMAC、ECCなどの384ビット暗号化をサポート
  • Lattice Propelを使用したPFRとセキュリティ機能のコンフィギュレーションにより開発を簡素化
  • 高い信頼性。同等のCMOS技術に比べ低消費電力で3倍のSER性能。

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ファミリーテーブル

Mach-NXデバイス選択ガイド
機能 LFMNX-50
ユーザーLC 8400
分散RAM(kビット) 73
EBR SRAM(kビット) 432
UFM(kビット) 1064 / 26691
PLL数 2
ハードウェア・セキュリティ機能2
コンフィギュラブルPFR 1
セキュア・エンクレーブ 1
SoCハードウェア機能
I2C 2
SPI 1
タイマー/カウンター 1
オシレータ 1
チップ上デュアルブート あり3
コアVcc:2.5 – 3.3V あり
温度
商用 あり
産業用 あり

1. デュアルブートのディスエーブル時には、イメージ・スペースを外部UFMとしての目的で使用可能
2. 40K LCと同等の設計
3. ユーザー・ロジック向け

0.8mmピッチ・パッケージと総 I/O数

LFMNX-50
256ボールcaBGA (14 x 14 mm) 200
484ボールcaBGA (19 x 19 mm) 379

ブロック図

Mach-NXアーキテクチャ

  • 最大8.4K LCのユーザー・ロジック、最大2669 kビットのユーザー・フラッシュ・メモリ、デュアルブート・フラッシュ機能
  • 1.2/1.5/1.8/2.5/3.3 I/O電圧をサポートする最大379のプログラマブルI/O
  • セキュア・エンクレーブにより384ビット暗号化をサポート

デザインリソース

開発キット&ボード

当社の開発キットとボードで設計プロセスの合理化

IP & リファレンスデザイン

事前検証済み、開発期間を短縮

開発ソフトウェア

使いやすく、開発に必要な機能を提供

ドキュメント

Quick Reference
Technical Resources
Information Resources
Downloads
TITLE NUMBER VERSION DATE FORMAT SIZE
Mach-NX Device Family Data Sheet
FPGA-DS-02084 .80 12/7/2020 PDF 3.3 MB
Mach-NX FCBGA484 Pinout
FPGA-SC-02020 .82 12/8/2020 CSV 16.6 KB
Mach-NX SFB Hardware Usage Guide
FPGA-TN-02222 0.81 3/2/2021 PDF 1.9 MB
Mach-NX sysIO Usage Guide
FPGA-TN-02233 1.0 12/8/2020 PDF 1.1 MB
Mach-NX sysCLOCK PLL Design and Usage Guide
FPGA-TN-02215 0.81 12/8/2020 PDF 2 MB
Mach-NX PFR and SFB Architecture Usage Guide
FPGA-TN-02230 0.82 3/10/2021 PDF 1.7 MB
Memory Usage Guide for Mach-NX Devices
FPGA-TN-02236 1.0 12/7/2020 PDF 7.7 MB
Mach-NX Hardware Checklist
FPGA-TN-02235 1.0 12/8/2020 PDF 793.2 KB
Reflow Temperature Guidelines and Moisture Sensitivity
FPGA-TN-02041 4.2 12/7/2020 PDF 770.7 KB
PCB Layout Recommendations for BGA Packages
FPGA-TN-02024 4.4 12/7/2020 PDF 4.7 MB
Implementing High Speed Interfaces with Mach-NX
FPGA-TN-02234 1.0 12/8/2020 PDF 2.2 MB
Package Diagrams
FPGA-DS-02053 6.3 5/12/2021 PDF 8.2 MB
TITLE NUMBER VERSION DATE FORMAT SIZE
Mach-NX Device Family Data Sheet
FPGA-DS-02084 .80 12/7/2020 PDF 3.3 MB
TITLE NUMBER VERSION DATE FORMAT SIZE
Mach-NX SFB Hardware Usage Guide
FPGA-TN-02222 0.81 3/2/2021 PDF 1.9 MB
Mach-NX sysIO Usage Guide
FPGA-TN-02233 1.0 12/8/2020 PDF 1.1 MB
Mach-NX sysCLOCK PLL Design and Usage Guide
FPGA-TN-02215 0.81 12/8/2020 PDF 2 MB
Mach-NX PFR and SFB Architecture Usage Guide
FPGA-TN-02230 0.82 3/10/2021 PDF 1.7 MB
Memory Usage Guide for Mach-NX Devices
FPGA-TN-02236 1.0 12/7/2020 PDF 7.7 MB
Mach-NX Hardware Checklist
FPGA-TN-02235 1.0 12/8/2020 PDF 793.2 KB
Reflow Temperature Guidelines and Moisture Sensitivity
FPGA-TN-02041 4.2 12/7/2020 PDF 770.7 KB
PCB Layout Recommendations for BGA Packages
FPGA-TN-02024 4.4 12/7/2020 PDF 4.7 MB
Implementing High Speed Interfaces with Mach-NX
FPGA-TN-02234 1.0 12/8/2020 PDF 2.2 MB
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Mach-NX FCBGA484 Pinout
FPGA-SC-02020 .82 12/8/2020 CSV 16.6 KB
Package Diagrams
FPGA-DS-02053 6.3 5/12/2021 PDF 8.2 MB
TITLE NUMBER VERSION DATE FORMAT SIZE
OrCAD Symbols
FPGA-SC-02019 12/8/2020 OLB 48.5 KB
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Product Selector Guide
I0211 30.0 5/11/2021 PDF 9.5 MB
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Mach-NX ホワイトペーパー
1.0 12/22/2020 PDF 317.9 KB
TITLE NUMBER VERSION DATE FORMAT SIZE
[BSDL] LFMNX-50
FPGA-MD-02011 1.14 12/8/2020 ZIP 18.4 KB
TITLE NUMBER VERSION DATE FORMAT SIZE
Mach-NX Device Family Delphi Models
FPGA-MD-02021 1.0 3/2/2021 ZIP 171.3 KB
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[IBIS] LFMNX-50
FPGA-MD-02012 1.0 2/25/2021 ZIP 15.4 MB

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