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  • CrossLink-NX 評価ボード

    Board

    CrossLink-NX 評価ボード

    CrossLink-NX 評価ボードは 40K ロジックセルのCrossLink-NXを搭載: ほとんどの I/O に簡単にアクセス可能、FPGA の PCIe 5G SERDES: FPGA メザニンカード (FMC)、Raspberry Pi、MIPI CSI-2、D-PHY、拡張用汎用ヘッダ
    CrossLink-NX 評価ボード
  • CNN Plus Accelerator IP

    IP Core

    CNN Plus Accelerator IP

    Implement Ultra-Low Power AI solutions with CNNs. Configure up to 16-bit widths. Works with Lattice Neural Network Compiler software tool.
    CNN Plus Accelerator IP
  • CSI-2 / DSI D-PHY トランスミッタ

    IP Core

  • CSI-2 / DSI D-PHY レシーバ

    IP Core

    CSI-2 / DSI D-PHY レシーバ

    MIPI D-PHY はカメラやディスプレイの標準的なインタフェースです。この IP を使用すると FPGA に D-PHY レシーバを実装できます。
    CSI-2 / DSI D-PHY レシーバ
  • FPD-Link トランスミッタ

    IP Core

    FPD-Link トランスミッタ

    OpenLDI / FPD-Link / LVDS トランスミッタ・インタフェース IP は ピクセルデータフォーマットのビデオデータを FPD-Link やその他の LVDS ディスプレイインタフェースへ変換します。
    FPD-Link トランスミッタ
  • FPD-Link レシーバ

    IP Core

    FPD-Link レシーバ

    OpenLDI / FPD-Link / LVDS レシーバ・インタフェース IP はプロセッサからの OpenLDI / FPD-Link / LVDS 入力をピクセルクロックドメインへ変換します。この IP は他の IP 組み合わせて MIPI DSI ディスプレイインタフェース変換として使用されます。
    FPD-Link レシーバ
  • SubLVDS イメージセンサーレシーバ

    IP Core

    SubLVDS イメージセンサーレシーバ

    MIPI D-PHY モジュラー IP - SubLVDS イメージセンサビデオデータをピクセルクロックドメインに変換
    SubLVDS イメージセンサーレシーバ
  • バイト ー ピクセル変換

    IP Core

  • ピクセル - バイト変換

    IP Core

    ピクセル - バイト変換

    MIPI D-PHY 用 モジュラー IP - ピクセルフォーマットデータをパラレルバイトフォーマットへ変換
    ピクセル - バイト変換
  • 4 入力 1 出力 MIPI CSI-2 アグリゲーション・リファレンスデザイン

    Reference Design

    4 入力 1 出力 MIPI CSI-2 アグリゲーション・リファレンスデザイン

    ラティス 4 入力 1 出力 MIPI CSI-2 イメージ・アグリゲーション・リファレンスデザイン は 4 つのイメージセンサからのデータを 1 つのデータとして HDMI 経由で出力するデザインを提供
    4 入力 1 出力 MIPI CSI-2 アグリゲーション・リファレンスデザイン
  • MIPI CSI-2 / DSI - OpenLDI I/F ブリッジ・リファレンスデザイン

    Reference Design

    MIPI CSI-2 / DSI - OpenLDI I/F ブリッジ・リファレンスデザイン

    CrossLink ファミリ向けリファレンスデザインは、MIPI DSI 出力のモバイルプロセッサや MIPI CSI-2 出力のイメージセンサと OpenLDI 入力のディスプレイを接続
    MIPI CSI-2 / DSI - OpenLDI I/F ブリッジ・リファレンスデザイン
  • N Input to 1 Output MIPI CSI-2 Side-by-Side Aggregation

    Reference Design

  • N 入力 - 1 出力 MIPI CSI-2 カメラ・アグリゲーション・ブリッジ

    Reference Design

    N 入力 - 1 出力 MIPI CSI-2 カメラ・アグリゲーション・ブリッジ

    CrossLink ファミリ用リファレンスデザインは、最小のレイテンシで複数の MIPI CSI-2 イメージセンサーをアプリケーションプロセッサに接続
    N 入力 - 1 出力 MIPI CSI-2 カメラ・アグリゲーション・ブリッジ
  • SubLVDS - MIPI CSI-2 イメージセンサ・ブリッジ・リファレンスデザイン

    Reference Design

    SubLVDS - MIPI CSI-2 イメージセンサ・ブリッジ・リファレンスデザイン

    CrossLink ファミリ FPGA リファレンスデザインは SubLVDS インタフェースのイメージセンサと MIPI CSI-2 インタフェースのアプリケーションプロセッサを接続
    SubLVDS - MIPI CSI-2 イメージセンサ・ブリッジ・リファレンスデザイン
  • I3C スレーブ IP コア

    IP Core

    I3C スレーブ IP コア

    CrossLink-NX 用ラティス I3C インタフェースは、バスが使用する電力を大幅に効率化しながら、I2C よりも 10 倍以上の速度向上を実現します。
    I3C スレーブ IP コア
  • I3C マスタ IP コア

    IP Core

    I3C マスタ IP コア

    CrossLink-NX 用 I3C インタフェースは、バスが使用する電力を大幅に効率化しながら、I2C よりも 10 倍以上の速度向上を実現します。
    I3C マスタ IP コア
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